Farid Lahrach

Ingénieur Électronicien FPGA DSP

Moves to Paris

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  • Indicative rate €550 / day
  • Experience 2-7 years
  • Response rate 100%
  • Response time 24h
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Location and geographical scope

Location
Paris, France
Can work in your office at
  • Paris and 50km around

Verifications

Languages

  • Arabe

    Native or bilingual

  • Anglais

    Full professional proficiency

  • Français

    Native or bilingual

Skills (12)

  • Beginner Intermediate Advanced
  • Beginner Intermediate Advanced
  • C
    Beginner Intermediate Advanced
  • Beginner Intermediate Advanced
  • R&D
    Beginner Intermediate Advanced
  • DSP
    Beginner Intermediate Advanced
  • Beginner Intermediate Advanced
  • Beginner Intermediate Advanced

Farid in a few words

Une expérience significative en développement FPGA et dans le domaine spatial.
Réalisation technique de projet: conception, développent et test de matériel (FPGA).
Architectures reconfigurables, environnement contraint, fiabilité des systèmes.
Connaissance des flows de développement, des architectures des derniers SoC (Xilinx UlttaScale...)

Experience

ALTER TUV

Aviation & Aerospace

Ingénieur électronicien

Toulouse, France

September 2012 - February 2013

Contexte :
Tests des nouveaux composants électroniques disponibles sur le marché pour des applications spatiales pour valider leur fiabilité.

Responsabilités :

- Analyse de cahiers de charges
- Design FPGA
• Simulation et synthèse
• Recherche d’architectures optimales
• Debug de systèmes complexes sur cible FPGA
- Développement en LabWindows/CVI de logiciels et matériels pour les nouveaux composants électroniques
- Architecture : Viretex 5
- Participation au tests des composants
  • FPAG
  • VHDL
  • LabWindows/CVI
  • R&D

CEA List

Aviation & Aerospace

Ingénieur Chercheur R&D

Paris, France

July 2016 - September 2018

Commissariat à l’énergie Atomique et aux énergies alternatives CEA LIST Développement des techniques pour augmenter le niveau de fiabilité d’un système à base de processeur Rocket-Chip (RISC-V) fonctionnant en mode Lockstep et des processeurs pour le calcul neuronal.
Responsabilités :
R&D :
• Développement d’un module JTAG pour le processeur PNeuro
• Fiabilité des systèmes reconfigurables
• Test de l’architecture électronique, tolérance aux fautes
• Techniques pour augmenter la fiabilité des systèmes sur puce SoC.
  • VHDL
  • FPGA
  • C
  • APB/AHB protocol
  • CHISEL
  • RISC-V

SAFRAN - SAFRAN GROUP

Aviation & Aerospace

Ingénieur Traitement du Signal FPGA

Les Ulis, France

June 2019 - February 2020

Contexte :
Développementen en cycle V d’un démodulateur à base de spectreétalé DSSS pour communication avec le drone de reconnaissance de l’armée française (drone Patroller)

Responsabilités :

- Design DSP [Digital Segment Processing]
- Design FPGA
• Simulation et synthèse
• Recherche d’architectures optimales
• Debug de systèmes complexes sur cible FPGA
• Portage VHDL de la technologie Xilinx vers la technologie ALTERA
- Développement RTL [Registre Transfert Level]
- Validation de l’architecture hardware du démodulateur
- Debuget optimisationdu design afin d’obtenir les performances définis dans le cahier des charge
- Spectre étalé DSSS
- Analyseur de spectre Rhode&Schwartz
- Développement C++ pour contrôle le démodulateur
  • FPGA
  • Xilinx
  • VHDL
  • DEBUG
  • C++
  • ChipeScope

Education

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