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Achille CauteAC

Achille Caute

Ingenieur FPGA/ASIC

€350/day
Languidic, FR
0-2 years

Average response time: 1 hour

About Achille

Bonjour, je viens de finir mon diplome d'ingénieur à l'INSA de Toulouse par un satge à ASML au pays bas, et dans l'attente du début de ma thèse au CEA-LETI je cherche des projets en freelance pour de la verification fonctionnelle ou du design d'IPs pour FPGA ou ASIC. J'ai déjà de l'expérience dans ce domaine via des projets personnels et des stages, en l'occurence à ASML en vérification fonctionnel utilisant l'UVM et en designe au LAAS-CNRS, sur de la localisation de sources sonores en utilisant un algorithme d'IA générative (SSVAE).
Egalement, je suis disponible jusqu'au 28 septembre.
  • English

    Fluent

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    Conversational

  • Dutch

    Conversational

  • French

    Native or bilingual

Remote only
Primarily works remotely

Experience

  • ASML
    UVM verification
    NANO-TECHNOLOGY
    February 2025 - July 2025 (5 months)
    Eindhoven, Netherlands
    • Vérification d'un pont AXI-MM vers Avalon-MM en utilisant l'UVM (Universal Verification Methodology), et une RAL (Register Abstraction Layer).
    • Design d'UVC (Universal Verification Components) pour les resets et les clocks du DUT (Design Under Test).
    • Design d'une IP Avalon "dummy", pour la vérification du DUT, en utilisant un langage de description de registres (ici systemRDL).
    • Environement de travail internationnal, principalement en anglais, et dans une moindre mesure en espagnol et en néerlandais.
    UVM VHDL Vérification systemeverilog
  • LAAS-CNRS
    Stage en IA embarquée pour la localisation de sources sonore
    RESEARCH
    June 2024 - September 2024 (3 months)
    Toulouse, France
    • Developpement et entrainement d'une IA générative (SSVAE) pour la localisation de source sonores (SSL). L'aspect génératif permettant de l'entrainement en ligne. Le tous en utilisant et PyTorch et Tensorflow
    • Implementation des algorithmes de traitement du signal pour le calcul des vecteurs d'entrés de nos réseaux de neuronnes (GCC PhaT, ScoT, Roth, et ITF)
    • Travail approfondie sur l'implementation matériel des ces algorithmes sur FPGA avec la création d'une esquisse de générateur d'IP pour l'accélaration des inférences de réseaux de neurones.
    FPGA VHDL Traitement du signal IA générative
  • Beyou Racing
    Trainee electronics technician
    ENTERTAINMENT AND LEISURE
    June 2023 - September 2023 (3 months)
    56100 Lorient, France
    • Montage de cable et de composant divers (camera, radar, VHF, alarmes, etc) sur les IMOCA Charal et Teamwork.
    • Creation d'un circuit de commande de feu de mat.
    • Mise a jour des plan des réseaux CAN et ethernet de Teamwork.

    • Création d'une application et d'une base de données pour l'accès rapide et centraliser des documents de maintenance des bateaux en utilisant le framework .NET (framework C# pour les application windows), et une base de donné SQL.
    Conception électronique montage de cable Développement Front-End SQL

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Education

  • Diplome d'ingérieur en éléctronique et automatique pour les system embarquées (AE-SE)
    Institue nationnal des sciences appliquées
    2025
    Il s'agit d'un diplome d'ingénieur en éléctronique et automatique orienté sur la conception de systèmes embarqués. Les principaux domaines d'études de la formation sont les suivants : - Conception de circuit éléctronique analogiques et numériques. - Automatique discrete et continue pour les sytèmes linéaire et non-linéaire. - Traitement du signal et modélisation des signaux. - Informatique et réseaux - Programmation embarquées D'autres champs sont explorés comme des notions de sécurité matériel et logiciel, IA et machine learning, nanophysique et sciences des semiconducteurs, base de données, télécommunication, etc.

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